- 说明
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摘要：
提出一种新的FFT信号处理器的实现方法,使用抽取算法在基于FPGA的FFT硬件处理IP上实现并行大点数快速傅立叶变换,由于采用专用FFT硬件处理与DSP相结合的处理结构,使处理速度大幅度提高.理论和仿真分析论证了该方法的有效性.
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2019-03-01
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436- 说明
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摘要：
为了满足大量连续数据加解密的 要求以及提高加密算法安全性的要求,采用有限状态机和流水线等关键技术,设计并实现了基于FPGA的3DES加密算法的加密电路.在Xilinx Virtex4系列的FPGA平台上采用ISE 10.1开发工具实现仿真验证和逻辑综合.结果表明,3DES加密系统的加解密速度可以达到860.660Mb/s,提高了加解密速度,并且有效减少了资 源占用率.最终,系统可广泛应用于网络安全产品及其他安全设备中.
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一种基于FPGA的3DES加密算法实现
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摘要：
大规模的可编程逻辑器件已经显著改变了数字系统的设计过程 ,并且 VHDL语言在设计中的作用也日益显著 .简要论述了关于 FPGA的 VHDL 设计中一些注意事项 ,提高电路描述的正确性 ,从而提高 FPGA设计的性能
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FPGA的VHDL设计策略
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摘要：
GPIB接口是测试仪器中常用的接口方式。通过将接口设计分解为同步状态机设计和寄存器读写电路设计，采用Verilog语言实现了满足IEEE488.1协议的IP Core设计。将此IP Core固化到FPGA芯片中即可实现GPIB各种接口功能。
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GPIB接口的FPGA实现
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摘要：
为了减小无人机数据链中的码间干扰,适应数据链对传输速度的要求,利用Verilog HDL设计DLMS算法,并在其中加入脉动阵结构,完成了均衡器的高速实现.仿真表明所设计的均衡器的最高频率可达298.063 MHz,这为以后设计更高频率或其他类型的高速均衡器指明了方向.
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DLMS算法的脉动阵结构设计及FPGA实现
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